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简要介绍了单比特瞬时测频接收机的原理,给出了应用于电子战接收机中的基于ECL电路单比特瞬时测频接收机的设计方案,在减小测频时间方面给出了快速测频算法的解决思路,通过信号测频算法的MATLAB仿真,对方案可行性进行了验证,仿真结果表明提出的设计方案可行,与传统电子站测频接收机相比,其具备结构尺寸小,测频精度高等优点。 相似文献
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提出了一种基于现场可编程门阵列器件FPGA并利用窗函数法实现一个16阶线性FIR．数字滤波器的设计方法。对于在FPGA中实现FIR．滤波器的关键部分——乘加运算,该设计主要采用了将乘加运算转化为查找表的并行分布式算法,与传统串行算法相比,这种方法可极大地减少硬件电路的规模,提高电路的执行速度并且充分利用了FPGA丰富的查表资源。从时域上对基带信号可直接进行成形,因此其实现的滤波器性能优于用DSP和传统方法实现的滤波器,特点是算量较小、精度高,更适用于实时系统。 相似文献
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